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HIGH-SPEED
64K x 16 DUAL-PORT
STATIC RAM
IDT7028L
True Dual-Ported memory cells which allow simultaneous
Features
◆
reads of the same memory location
◆
M/ S = V IH for BUSY output flag on Master,
M/ S = V IL for BUSY input on Slave
◆
◆
◆
◆
High-speed access
– Commercial: 15/20ns (max.)
– Industrial: 20ns (max.)
Low-power operation
– IDT7028L
Active: 1W (typ.)
Standby: 1mW (typ.)
Dual chip enables allow for depth expansion without
external logic
IDT7028 easily expands data bus width to 32 bits or
more using the Master/Slave select when cascading more
◆
◆
◆
◆
◆
◆
◆
◆
Interrupt Flag
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
Separate upper-byte and lower-byte controls for multi-
plexed bus and bus matching compatibility
TTL-compatible, single 5V (±10%) power supply
Available in a 100-pin TQFP
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
than one device
Functional Block Diagram
R/ W L
UB L
CE 0L
CE 1L
OE L
LB L
I/O 8-15L
I/O
I/O
R/ W R
UB R
CE 0R
CE 1R
OE R
LB R
I/O 8-15R
I/O 0-7L
Control
Control
I/O 0-7R
BUSY L
(1,2)
BUSY R
(1,2)
A 15L
A 0L
Address
Decoder
64Kx16
MEMORY
ARRAY
7028
Address
Decoder
A 15R
A 0R
16
16
SEM L
CE 0L
CE 1L
OE L
R/ W L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
CE 0R
CE 1R
OE R
R/ W R
SEM R
INT L
M/ S
(2)
(2)
NOTES:
1. BUSY is an input as a Slave (M/ S = V IL ) and an output when it is a Master (M/ S = V IH ).
INT R
4836 drw 01
(2)
2. BUSY and INT are non-tri-state totem-pole outputs (push-pull).
?2009 Integrated Device Technology, Inc.
1
JANUARY 2009
DSC-4836/4
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